存儲器的組成框圖

Ⅰ 存儲器由哪幾部分組成，如何使用

存儲器由存儲體、地址解碼器和控制電路組成。

1)存儲體是存儲數據信息的載體。由一系列存儲單元組成，每個存儲單元都有確定的地址。存儲單元通常按位元組編址，一個存儲單元為一個位元組，每個位元組能存放一個8位二進制數。就像一個大倉庫，分成許多房間，大倉庫相當於存儲體，房間相當於位元組，房間都有編號，編號就是地址。

2)地址解碼器將CPU發出的地址信號轉換為對存儲體中某一存儲單元的選通信號。相當於CPU給出地址，地址解碼器找出相應地址房間的鑰匙。通常地址是8位或1 6位，輸入到地址解碼器，產生相應的選通線，8位地址能產生28=256根選通線，即能選通256位元組。16位地址能產生216=65536=64K根選通線，即能選通64K位元組。當然要產生65536根選通線是很難想像的，實際上它是分成256根行線和256根列線，256 X 256=65536，合起來能選通65536個存儲單元。

3)存儲器控制電路包括片選控制、讀／寫控制和帶三態門的輸入／輸出緩沖電路。

①片選控制確定存儲器晶元是否工作。

②讀/寫控制確定數據傳輸方向；若是讀指令，則將已被選通的存儲單元中的內容傳送到數據匯流排上；若是寫指令，則將數據匯流排上的數據傳送到已被選通的存儲單元中。

③帶三態門的輸入/輸出緩沖電路用於數據緩沖和防止匯流排上數據競爭。數據匯流排相當於一條車流頻繁的大馬路，必須在綠燈條件下，車輛才能進入這條大馬路，否則要撞車發生交通事故。同理，存儲器的輸出端是連接在數據匯流排上的，存儲器中的數據是不能隨意傳送到數據匯流排上的。例如，若數據匯流排上的數據是「1」(高電平5V)，存儲器中的數據是「0」(低電平OV)，兩種數據若碰到一起就會發生短路而損壞單片機。因此，存儲器輸出埠不僅能呈現「1」和「O」兩種狀態，還應具有第三種狀態「高阻"態。呈「高阻"態時，它們的輸出埠相當於斷開，對數據匯流排不起作用，此時數據匯流排可被其他器件佔用。當其他器件呈「高阻"態時，存儲器在片選允許和輸出允許的條件下，才能將自己的數據輸出到數據匯流排上。

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Ⅱ 有一個16K*16位的存儲器,由1K*4位的DRAM晶元構成,畫出存儲體的組成框圖

按大小來看，一共需要16塊DRAM晶元，將每四塊分為一組
，形成32位的數據寬度，根據該儲存容量大小一共需要16位地址線
（可以根據儲存容量除以數據寬度來確定）。
將地址線的低14位作為全部DRAM晶元的地址，然後將高2位作為組片選信號，
即選擇各組輸出的32位數據。

Ⅲ 存儲器是由哪四部分組成每部分的作用是什麼

存儲器是由存儲體、地址寄存器、地址解碼驅動電路、讀/寫控制邏輯、數據寄存器、讀/寫驅動器等六個部分組成

存儲體是存儲器的核心，是存儲單元的集合體
地址寄存器用於存放CPU訪問存儲單元的地址，經解碼驅動後指向相應的存儲單元。
解碼器將地址匯流排輸入的地址碼轉換成與其對應的解碼輸出線上的高電平或低電平信號，以表示選中了某一單元，並由驅動器提供驅動電流去驅動相應的讀/寫電路，完成對被選中單元的讀/寫操作。
讀/寫驅動器用以完成對被選中單元中各位的讀/寫操作，包括讀出放大器、寫入電路和讀/寫控制電路。
數據寄存器用於暫時存放從存儲單元讀出的數據，或從CPU輸出I/O埠輸入的要寫入存儲器的數據。
讀/寫控制邏輯接收來自CPU的啟動、片選、讀/寫及清除命令，經控制電路綜合處理後，發出一組時序信號來控制存儲器的讀/寫操作。
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Ⅳ 存儲器的構成

構成存儲器的存儲介質，存儲元，它可存儲一個二進制代碼。由若干個存儲元組成一個存儲單元，然後再由許多存儲單元組成一個存儲器。一個存儲器包含許多存儲單元，每個存儲單元可存放一個位元組（按位元組編址）。每個存儲單元的位置都有一個編號，即地址，一般用十六進製表示。一個存儲器中所有存儲單元可存放數據的總和稱為它的存儲容量。假設一個存儲器的地址碼由20位二進制數（即5位十六進制數）組成，則可表示2的20次方，即1M個存儲單元地址。每個存儲單元存放一個位元組，則該存儲器的存儲容量為1MB。

Ⅳ 畫出該存儲器的組成邏輯框圖

按大小來看，一共需要16塊DRAM晶元，將每四塊分為一組，形成32位的數據寬度，根據該儲存容量大小一共需要16位地址線（可以根據儲存容量除以數據寬度來確定）。將地址線的低14位作為全部DRAM晶元的地址，然後將高2位作為組片選信號，即選擇各組輸出的32位數據。

Ⅵ 存儲器由什麼組成

存儲器一般由內存和外存組成。一般內存主要為內存條。外在主要指硬碟、U盤等。

Ⅶ 用32K*8位的EPROM晶元組成128K*16位的只讀存儲器,儲存器的組成框圖怎樣畫

X*Y位，其中，X晶元的存儲單元格數，Y每個存儲單元存儲數據的位數。所以，對於一片晶元來說。

由X能知道需要多大的地址緩存才能夠表示所有的地址，由Y能知道需要多大的數據緩存。首先是X，按照2進制，1024就是1K，也就是2的10次方，也就是1K。

(7)存儲器的組成框圖擴展閱讀：

用1K×4位的DRAM晶元構成4K×8位存儲器。是一個64K 1bit的DRAM晶元，將8片並接起來，可以構成64KB的動態存儲器。

每片只有一條輸入數據線，而地址引腳只有8條。為了形成64K地址，必須在系統地址匯流排和晶元地址引線之間專門設計一個地址形成電路。

使系統地址匯流排信號能分時地加到8個地址的引腳上，藉助晶元內部的行鎖存器、列鎖存器和解碼電路選定晶元內的存儲單元，鎖存信號也靠著外部地址電路產生。

Ⅷ 16k*8位SRAM晶元構成64k*16位的存儲器,要求畫出該存儲器的組成邏輯框圖

首先要滿足位寬的要求，2片16*8並行組成16*16的結構，地址線相同，數據線擴展，然後在滿足容量用4個16*16的結構構成64*16，地址線擴展，數據線相同，地址線上多數要加解碼器來片選，常見3-8解碼器138。

Ⅸ 存儲器的結構組成

微機系統中主存儲器通常由若干存儲晶元及相應的存儲控制組織而成，並通過存儲匯流排(數據匯流排、地址匯流排和控制匯流排)與CPU及其他部件相聯系，以實現數據信息、控制信息的傳輸。由於存儲器晶元的容量有限，實際應用中對存儲器的字長和位長都會有擴展的要求。