時間存儲器做什麼

㈠ cache在計算機中的作用是什麼

高速緩沖存儲器是存在於主存與CPU之間的一級存儲器，具體作用如下：

在計算機技術發展過程中,主存儲器存取速度一直比中央處理器操作速度慢得多，使中央處理器的高速處理能力不能充分發揮，整個計算機系統的工作效率受到影響。

有很多方法可用來緩和中央處理器和主存儲器之間速度不匹配的矛盾，如採用多個通用寄存器、多存儲體交叉存取等，在存儲層次上採用高速緩沖存儲器也是常用的方法之一。很多大、中型計算機以及新近的一些小型機、微型機也都採用高速緩沖存儲器。

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Cache組成部分

主要由三大部分組成：坦枝

Cache存儲體：存放由主存調入的指令與數據塊。

地址轉換部件：建立目錄表以實現主存地址到緩存慶缺地址的讓差敏轉換。

替換部件：在緩存已滿時按一定策略進行數據塊替換，並修改地址轉換部件。

㈡ 存儲器可分為哪三類

存儲器不僅可以分為三類。因為按照不同的劃分方法，存儲器可分為不同種類。常見的分類方法如下。

一、按存儲介質劃分

1. 半導體存儲器：用半導體器件組成的存儲器。

2. 磁表面存儲器：用磁性材料做成的存儲器。

二、按存儲方式劃分

1. 隨機存儲器：任何存儲單元的內容都能被隨機存取，且存取時間和存儲單元的物理位置無關。

2. 順序存儲器：只能按某種順序來存取，存取時間和存儲單元的物理位置有關。

三、按讀寫功能劃分

1. 只讀存儲器(ROM)：存儲的內容是固定不變的，只能讀出而不能寫入的半導體存儲器。

2. 隨機讀寫存儲器(RAM)：既能讀出又能寫入的存儲器。

二、選用各種存儲器，一般遵循的選擇如下：

1、內部存儲器與外部存儲器

一般而言，內部存儲器的性價比最高但靈活性最低，因此用戶必須確定對存儲的需求將來是否會增長，以及是否有某種途徑可以升級到代碼空間更大的微控制器。基於成本考慮，用戶通常選擇能滿足應用要求的存儲器容量最小的微控制器。

2、引導存儲器

在較大的微控制器系統或基於處理器的系統中，用戶可以利用引導代碼進行初始化。應用本身通常決定了是否需要引導代碼，以及是否需要專門的引導存儲器。

3、配置存儲器

對於現場可編程門陣列(FPGA）或片上系統(SoC)，可以使用存儲器來存儲配置信息。這種存儲器必須是非易失性EPROM、EEPROM或快閃記憶體。大多數情況下，FPGA採用SPI介面，但一些較老的器件仍採用FPGA串列介面。

4、程序存儲器

所有帶處理器的系統都採用程序存儲器，但是用戶必須決定這個存儲器是位於處理器內部還是外部。在做出了這個決策之後，用戶才能進一步確定存儲器的容量和類型。

5、數據存儲器

與程序存儲器類似，數據存儲器可以位於微控制器內部，或者是外部器件，但這兩種情況存在一些差別。有時微控制器內部包含SRAM(易失性)和EEPROM(非易失)兩種數據存儲器，但有時不包含內部EEPROM，在這種情況下，當需要存儲大量數據時，用戶可以選擇外部的串列EEPROM或串列快閃記憶體器件。

6、易失性和非易失性存儲器

存儲器可分成易失性存儲器或者非易失性存儲器，前者在斷電後將丟失數據，而後者在斷電後仍可保持數據。用戶有時將易失性存儲器與後備電池一起使用，使其表現猶如非易失性器件，但這可能比簡單地使用非易失性存儲器更加昂貴。

7、串列存儲器和並行存儲器

對於較大的應用系統，微控制器通常沒有足夠大的內部存儲器。這時必須使用外部存儲器，因為外部定址匯流排通常是並行的，外部的程序存儲器和數據存儲器也將是並行的。

8、EEPROM與快閃記憶體

存儲器技術的成熟使得RAM和ROM之間的界限變得很模糊，如今有一些類型的存儲器（比如EEPROM和快閃記憶體）組合了兩者的特性。這些器件像RAM一樣進行讀寫，並像ROM一樣在斷電時保持數據，它們都可電擦除且可編程，但各自有它們優缺點。

參考資料來源：網路——存儲器

㈢ 什麼是存儲器的存取時間什麼是存取周期兩者之間有什麼區別

存取時間是每次向內存寫入（讀出）數據到完成所需要的所有時間，如寫入時間是指從存儲器接收到數據到寫入被選中位置所需要的時間 讀出同理
存取周期是值 存儲器進行連續兩次獨立的讀（寫）操作所需要的最小時間間隔，
通常存取周期大於存取時間

㈣ 存儲器的存取時間是指什麼

數據存儲 和 讀取時間，簡單對於硬碟來說 就是讀寫速度

㈤ 存儲器為什麼要分為內存和外存二者有什麼區別

存儲器分內存和外存，是因為沒有一種內存可以既速度飛快，又保存東西長久，還便宜。所以，用內存和外存的組合來解決這個問題。

1、存儲器有兩個作用，一個是存儲文件，關機不丟失，另一個是運行程序，和cpu交換數據。簡單講，二者的區別是，外存是存儲東西的，內存是運行程序的。
2、硬碟是主要的外存。它完成第一個任務是沒問題的，但完成第二個任務不能勝任，因為速度太慢了，起碼慢100倍。於是只好用內存來代替它，完成第二個任務。
3、但內存雖然速度快，價格卻非常貴，而且關機文件就丟失，也不能做成很大的容量，所以，還得硬碟來輔助。所以，就造成了內存結合外存的局面。

也就是說，如果有一天，內存可以實現關機不丟失、容量大、便宜，且速度飛快，那麼，就只需要內存，不需要外存了。現在的SSD有這個傾向，但它的速度比起真正的內存來還是差了很多倍。

㈥ 存取時間與存取周期的區別存儲器帶寬的含義是什麼

存儲器帶寬的含義是指單位時間里存儲器所存取的信息量。

一、主體不同

1、存取時間：是CPU讀或寫內存內數據的過程時間。

2、存取周期：連續啟動兩次獨立的「讀」或「寫」操作（如連續的兩次「讀」操作）所需的最短時間。

二、原理不同

1、存取時間：從CPU發出指令給內存時，便會要求內存取用特定地址的數據，內存響應CPU後便會將CPU所需要的數據送給CPU，一直到CPU收到數據為止，便成為一個讀取的流程。

2、存取周期：將存儲單元與存儲寄存器(MDR)之間進行讀寫。存儲器從接收讀出命令到被讀出信息穩定在MDR的輸出端為止的時間間隔。

三、代表含義不同

1、存取時間：用存取時間的倒數來表示速度。

2、存取周期：為存儲器的性能指標之一，直接影響電子計算機的技術性能。

㈦ 在計算機中什麼是內存存取時間和存儲周期

存取時間，指的是CPU讀或寫內存內數據的過程時間。

以讀取為例，從CPU發出指令給內存時，便會要求內存取用特定地址的數據，內存響應CPU後便會將CPU所需要的數據送給CPU，一直到CPU收到數據為止，便成為一個讀取的流程。

存儲周期：連續啟動兩次讀或寫操作所需間隔的最小時間

內存的存取周期一般為60ns-120ns。單位以納秒（ns）度量，換算關系1ns=10-6ms=10-9s，常見的有60ns、70ns、80ns、120ns等幾種，相應在內存條上標為-6、-7、-8、-120等字樣。這個數值越小，存取速度越快。

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存儲器的兩個基本操作為「讀出」與「寫入」，是指將存儲單元與存儲寄存器(MDR)之間進行讀寫。存儲器從接收讀出命令到被讀出信息穩定在MDR的輸出端為止的時間間隔，稱為「取數時間TA」。兩次獨立的存取操作之間所需最短時間稱為「存儲周期TMC」。半導體存儲器的存取周期一般為6ns～10ns。

其中存儲單元(memory location)簡稱「單元」。為存儲器中存儲一機器字或一位元組的空間位置。一個存儲器劃分為若干存儲單元，並按一定順序編號，稱為「地址」。如一存儲單元存放一有獨立意義的代碼。即存放作為一個整體來處理或運算的一組數字，則稱為「字」。

字的長度，即字所包含的位數，稱為「字長」。如以位元組來劃分存儲單元，則一機器字常須存放在幾個存儲單元中。存儲單元中的內容一經寫入，雖經反復使用，仍保持不變。如須寫入新內容，則原內容被「沖掉」，而變成新寫入的內容。

㈧ 如何利用CPU時間存儲器，OB35做計時器

OB35作為中斷block,中斷時間為100ms,意思就是100ms運行一次，所以，假設MB86的初始值是0.
那麼每過100ms,MB86就+1. 當MB86=10,就是一個1s的脈沖。 程序中應該還有當MB86==一個值時將MB86置0.也應該有當MB86==某個值時 將MB86.1置1.這樣根據MB==不同的數值，就可以得到不同的脈沖。

㈨ 什麼是Cache作用是什麼

Cache指的是緩存。

高速緩存（英語：cache，/kæʃ/kash[2][3][4]）簡稱緩存，原始意義是指訪問速度比一般隨機存取存儲器（RAM）快的一種RAM，通常它不像系統主存那樣使用DRAM技術，而使用昂貴但較快速的SRAM技術。

提供「緩存」的目的是為了讓數據訪問的速度適應CPU的處理速度，其基於的原理是內存中「程序執行與數據訪問的局域性行為」，即一定程序執行時間和空間內，被訪問的代碼集中於一部分。

為了充分發揮緩存的作用，不僅依靠「暫存剛剛訪問過的數據」，還要使用硬體實現的指令預測與數據預取技術——盡可能把將要使用的數據預先從內存中取到緩存里。

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緩存的特點

緩存是指可以進行高速數據交換的存儲器，它先於內存與CPU交換數據，因此速率很快。L1Cache(一級緩存)是CPU第一層高速緩存。

內置的L1高速緩存的容量和結構對CPU的性能影響較大，不過高速緩沖存儲器均由靜態RAM組成，結構較復雜，在CPU管芯面積不能太大的情況下，L1級高速緩存的容量不可能做得太大。一般L1緩存的容量通常在32—256KB。

L2Cache(二級緩存)是CPU的第二層高速緩存，分內部和外部兩種晶元。內部的晶元二級緩存運行速率與主頻相同，而外部的二級緩存則只有主頻的一半。

L2高速緩存容量也會影響CPU的性能，原則是越大越好，普通台式機CPU的L2緩存一般為128KB到2MB或者更高，筆記本、伺服器和工作站上用CPU的L2高速緩存最高可達1MB-3MB。

緩存只是內存中少部分數據的復製品，所以CPU到緩存中尋找數據時，也會出現找不到的情況（因為這些數據沒有從內存復制到緩存中去），這時CPU還是會到內存中去找數據，這樣系統的速率就慢下來了，不過CPU會把這些數據復制到緩存中去，以便下一次不要再到內存中去取。

隨著時間的變化，被訪問得最頻繁的數據不是一成不變的，也就是說，剛才還不頻繁的數據，此時已經需要被頻繁的訪問，剛才還是最頻繁的數據，又不頻繁了，所以說緩存中的數據要經常按照一定的演算法來更換，這樣才能保證緩存中的數據是被訪問最頻繁的。

㈩ 存儲器的原理是什麼

存儲器講述工作原理及作用

介紹

存儲器(Memory)是現代信息技術中用於保存信息的記憶設備。其概念很廣，有很多層次，在數字系統中，只要能保存二進制數據的都可以是存儲器;在集成電路中，一個沒有實物形式的具有存儲功能的電路也叫存儲器，如RAM、FIFO等;在系統中，具有實物形式的存儲設備也叫存儲器，如內存條、TF卡等。計算機中全部信息，包括輸入的原始數據、計算機程序、中間運行結果和最終運行結果都保存在存儲器中。它根據控制器指定的位置存入和取出信息。有了存儲器，計算機才有記憶功能，才能保證正常工作。計算機中的存儲器按用途存儲器可分為主存儲器(內存)和輔助存儲器(外存),也有分為外部存儲器和內部存儲器的分類方法。外存通常是磁性介質或光碟等，能長期保存信息。內存指主板上的存儲部件，用來存放當前正在執行的數據和程序，但僅用於暫時存放程序和數據，關閉電源或斷電，數據會丟失。

2.按存取方式分類

(1)隨機存儲器(RAM)：如果存儲器中任何存儲單元的內容都能被隨機存取，且存取時間與存儲單元的物理位置無關，則這種存儲器稱為隨機存儲器(RAM)。RAM主要用來存放各種輸入/輸出的程序、數據、中間運算結果以及存放與外界交換的信息和做堆棧用。隨機存儲器主要充當高速緩沖存儲器和主存儲器。

(2)串列訪問存儲器(SAS)：如果存儲器只能按某種順序來存取，也就是說，存取時間與存儲單元的物理位置有關，則這種存儲器稱為串列訪問存儲器。串列存儲器又可分為順序存取存儲器(SAM)和直接存取存儲器(DAM)。順序存取存儲器是完全的串列訪問存儲器，如磁帶，信息以順序的方式從存儲介質的始端開始寫入(或讀出);直接存取存儲器是部分串列訪問存儲器，如磁碟存儲器，它介於順序存取和隨機存取之間。

(3)只讀存儲器(ROM)：只讀存儲器是一種對其內容只能讀不能寫入的存儲器，即預先一次寫入的存儲器。通常用來存放固定不變的信息。如經常用作微程序控制存儲器。目前已有可重寫的只讀存儲器。常見的有掩模ROM(MROM)，可擦除可編程ROM(EPROM)，電可擦除可編程ROM(EEPROM).ROM的電路比RAM的簡單、集成度高，成本低，且是一種非易失性存儲器，計算機常把一些管理、監控程序、成熟的用戶程序放在ROM中。

3.按信息的可保存性分類

非永久記憶的存儲器：斷電後信息就消失的存儲器，如半導體讀/寫存儲器RAM。

永久性記憶的存儲器：斷電後仍能保存信息的存儲器，如磁性材料做成的存儲器以及半導體ROM。

4.按在計算機系統中的作用分

根據存儲器在計算機系統中所起的作用，可分為主存儲器、輔助存儲器、高速緩沖存儲器、控制存儲器等。為了解決對存儲器要求容量大，速度快，成本低三者之間的矛盾，目前通常採用多級存儲器體系結構，即使用高速緩沖存儲器、主存儲器和外存儲器。

能力影響

從寫命令轉換到讀命令，在某個時間訪問某個地址，以及刷新數據等操作都要求數據匯流排在一定時間內保持休止狀態，這樣就不能充分利用存儲器通道。此外，寬並行匯流排和DRAM內核預取都經常導致不必要的大數據量存取。在指定的時間段內，存儲器控制器能存取的有用數據稱為有效數據速率，這很大程度上取決於系統的特定應用。有效數據速率隨著時間而變化，常低於峰值數據速率。在某些系統中，有效數據速率可下降到峰值速率的10%以下。

通常，這些系統受益於那些能產生更高有效數據速率的存儲器技術的變化。在CPU方面存在類似的現象，最近幾年諸如AMD和 TRANSMETA等公司已經指出，在測量基於CPU的系統的性能時，時鍾頻率不是唯一的要素。存儲器技術已經很成熟，峰值速率和有效數據速率或許並不比以前匹配的更好。盡管峰值速率依然是存儲器技術最重要的參數之一，但其他結構參數也可以極大地影響存儲器系統的性能。

影響有效數據速率的參數

有幾類影響有效數據速率的參數，其一是導致數據匯流排進入若干周期的停止狀態。在這類參數中，匯流排轉換、行周期時間、CAS延時以及RAS到CAS的延時(tRCD)引發系統結構中的大部分延遲問題。

匯流排轉換本身會在數據通道上產生非常長的停止時間。以GDDR3系統為例，該系統對存儲器的開放頁不斷寫入數據。在這期間，存儲器系統的有效數據速率與其峰值速率相當。不過，假設100個時鍾周期中，存儲器控制器從讀轉換到寫。由於這個轉換需要6個時鍾周期，有效的數據速率下降到峰值速率的 94%。在這100個時鍾周期中，如果存儲器控制器將匯流排從寫轉換到讀的話，將會丟失更多的時鍾周期。這種存儲器技術在從寫轉換到讀時需要15個空閑周期，這會將有效數據速率進一步降低到峰值速率的79%。表1顯示出針幾種高性能存儲器技術類似的計算結果。

顯然，所有的存儲器技術並不相同。需要很多匯流排轉換的系統設計師可以選用諸如XDR、RDRAM或者DDR2這些更高效的技術來提升性能。另一方面，如果系統能將處理事務分組成非常長的讀寫序列，那麼匯流排轉換對有效帶寬的影響最小。不過，其他的增加延遲現象，例如庫(bank)沖突會降低有效帶寬，對性能產生負面影響。

DRAM技術要求庫的頁或行在存取之前開放。一旦開放，在一個最小周期時間，即行周期時間(tRC)結束之前，同一個庫中的不同頁不能開放。對存儲器開放庫的不同頁存取被稱為分頁遺漏，這會導致與任何tRC間隔未滿足部分相關的延遲。對於還沒有開放足夠周期以滿足tRC間隙的庫而言，分頁遺漏被稱為庫沖突。而tRC決定了庫沖突延遲時間的長短，在給定的DRAM上可用的庫數量直接影響庫沖突產生的頻率。

大多數存儲器技術有4個或者8個庫，在數十個時鍾周期具有tRC值。在隨機負載情況下，那些具有8個庫的內核比具有4個庫的內核所發生的庫沖突更少。盡管tRC與庫數量之間的相互影響很復雜，但是其累計影響可用多種方法量化。

存儲器讀事務處理

考慮三種簡單的存儲器讀事務處理情況。第一種情況，存儲器控制器發出每個事務處理，該事務處理與前一個事務處理產生一個庫沖突。控制器必須在打開一個頁和打開後續頁之間等待一個tRC時間，這樣增加了與頁循環相關的最大延遲時間。在這種情況下的有效數據速率很大程度上決定於I/O，並主要受限於DRAM內核電路。最大的庫沖突頻率將有效帶寬削減到當前最高端存儲器技術峰值的20%到30%。

在第二種情況下，每個事務處理都以隨機產生的地址為目標。此時，產生庫沖突的機會取決於很多因素，包括tRC和存儲器內核中庫數量之間的相互作用。tRC值越小，開放頁循環地越快，導致庫沖突的損失越小。此外，存儲器技術具有的庫越多，隨機地址存取庫沖突的機率就越小。

第三種情況，每個事務處理就是一次頁命中，在開放頁中定址不同的列地址。控制器不必訪問關閉頁，允許完全利用匯流排，這樣就得到一種理想的情況，即有效數據速率等於峰值速率。

第一種和第三種情況都涉及到簡單的計算，隨機情況受其他的特性影響，這些特性沒有包括在DRAM或者存儲器介面中。存儲器控制器仲裁和排隊會極大地改善庫沖突頻率，因為更有可能出現不產生沖突的事務處理，而不是那些導致庫沖突的事務處理。

然而，增加存儲器隊列深度未必增加不同存儲器技術之間的相對有效數據速率。例如，即使增加存儲器控制隊列深度，XDR的有效數據速率也比 GDDR3高20%。存在這種增量主要是因為XDR具有更高的庫數量以及更低的tRC值。一般而言，更短的tRC間隔、更多的庫數量以及更大的控制器隊列能產生更高的有效帶寬。

實際上，很多效率限制現象是與行存取粒度相關的問題。tRC約束本質上要求存儲器控制器從新開放的行中存取一定量的數據，以確保數據管線保持充滿。事實上，為保持數據匯流排無中斷地運行，在開放一個行之後，只須讀取很少量的數據，即使不需要額外的數據。

另外一種減少存儲器系統有效帶寬的主要特性被歸類到列存取粒度范疇，它規定了每次讀寫操作必須傳輸的數據量。與之相反，行存取粒度規定每個行激活(一般指每個RAS的CAS操作)需要多少單獨的讀寫操作。列存取粒度對有效數據速率具有不易於量化的巨大影響。因為它規定一個讀或寫操作中需要傳輸的最小數據量，列存取粒度給那些一次只需要很少數據量的系統帶來了問題。例如，一個需要來自兩列各8位元組的16位元組存取粒度系統，必須讀取總共32位元組以存取兩個位置。因為只需要32個位元組中的16個位元組，系統的有效數據速率降低到峰值速率的50%。匯流排帶寬和脈沖時間長度這兩個結構參數規定了存儲器系統的存取粒度。

匯流排帶寬是指連接存儲器控制器和存儲器件之間的數據線數量。它設定最小的存取粒度，因為對於一個指定的存儲器事務處理，每條數據線必須至少傳遞一個數據位。而脈沖時間長度則規定對於指定的事務處理，每條數據線必須傳遞的位數量。每個事務處理中的每條數據線只傳一個數據位的存儲技術，其脈沖時間長度為1。總的列存取粒度很簡單：列存取粒度=匯流排寬度×脈沖時間長度。

很多系統架構僅僅通過增加DRAM器件和存儲匯流排帶寬就能增加存儲系統的可用帶寬。畢竟，如果4個400MHz數據速率的連接可實現 1.6GHz的總峰值帶寬，那麼8個連接將得到3.2GHz。增加一個DRAM器件，電路板上的連線以及ASIC的管腳就會增多，總峰值帶寬相應地倍增。

首要的是，架構師希望完全利用峰值帶寬，這已經達到他們通過物理設計存儲器匯流排所能達到的最大值。具有256位甚或512位存儲匯流排的圖形控制器已並不鮮見，這種控制器需要1,000個，甚至更多的管腳。封裝設計師、ASIC底層規劃工程師以及電路板設計工程師不能找到採用便宜的、商業上可行的方法來對這么多信號進行布線的矽片區域。僅僅增加匯流排寬度來獲得更高的峰值數據速率，會導致因為列存取粒度限制而降低有效帶寬。

假設某個特定存儲技術的脈沖時間長度等於1，對於一個存儲器處理，512位寬系統的存取粒度為512位(或者64位元組)。如果控制器只需要一小段數據，那麼剩下的數據就被浪費掉，這就降低了系統的有效數據速率。例如，只需要存儲系統32位元組數據的控制器將浪費剩餘的32位元組，進而導致有效的數據速率等於50%的峰值速率。這些計算都假定脈沖時間長度為1。隨著存儲器介面數據速率增加的趨勢，大多數新技術的最低脈沖時間長度都大於1。

選擇技巧

存儲器的類型將決定整個嵌入式系統的操作和性能，因此存儲器的選擇是一個非常重要的決策。無論系統是採用電池供電還是由市電供電，應用需求將決定存儲器的類型(易失性或非易失性)以及使用目的(存儲代碼、數據或者兩者兼有)。另外，在選擇過程中，存儲器的尺寸和成本也是需要考慮的重要因素。對於較小的系統，微控制器自帶的存儲器就有可能滿足系統要求，而較大的系統可能要求增加外部存儲器。為嵌入式系統選擇存儲器類型時，需要考慮一些設計參數，包括微控制器的選擇、電壓范圍、電池壽命、讀寫速度、存儲器尺寸、存儲器的特性、擦除/寫入的耐久性以及系統總成本。

選擇存儲器時應遵循的基本原則

1、內部存儲器與外部存儲器

一般情況下，當確定了存儲程序代碼和數據所需要的存儲空間之後，設計工程師將決定是採用內部存儲器還是外部存儲器。通常情況下，內部存儲器的性價比最高但靈活性最低，因此設計工程師必須確定對存儲的需求將來是否會增長，以及是否有某種途徑可以升級到代碼空間更大的微控制器。基於成本考慮，人們通常選擇能滿足應用要求的存儲器容量最小的微控制器，因此在預測代碼規模的時候要必須特別小心，因為代碼規模增大可能要求更換微控制器。目前市場上存在各種規模的外部存儲器器件，我們很容易通過增加存儲器來適應代碼規模的增加。有時這意味著以封裝尺寸相同但容量更大的存儲器替代現有的存儲器，或者在匯流排上增加存儲器。即使微控制器帶有內部存儲器，也可以通過增加外部串列EEPROM或快閃記憶體來滿足系統對非易失性存儲器的需求。

2、引導存儲器

在較大的微控制器系統或基於處理器的系統中，設計工程師可以利用引導代碼進行初始化。應用本身通常決定了是否需要引導代碼，以及是否需要專門的引導存儲器。例如，如果沒有外部的定址匯流排或串列引導介面，通常使用內部存儲器，而不需要專門的引導器件。但在一些沒有內部程序存儲器的系統中，初始化是操作代碼的一部分，因此所有代碼都將駐留在同一個外部程序存儲器中。某些微控制器既有內部存儲器也有外部定址匯流排，在這種情況下，引導代碼將駐留在內部存儲器中，而操作代碼在外部存儲器中。這很可能是最安全的方法，因為改變操作代碼時不會出現意外地修改引導代碼。在所有情況下，引導存儲器都必須是非易失性存儲器。

可以使用任何類型的存儲器來滿足嵌入式系統的要求，但終端應用和總成本要求通常是影響我們做出決策的主要因素。有時，把幾個類型的存儲器結合起來使用能更好地滿足應用系統的要求。例如，一些PDA設計同時使用易失性存儲器和非易失性存儲器作為程序存儲器和數據存儲器。把永久的程序保存在非易失性ROM中，而把由用戶下載的程序和數據存儲在有電池支持的易失性DRAM中。不管選擇哪種存儲器類型，在確定將被用於最終應用系統的存儲器之前，設計工程師必須仔細折中考慮各種設計因素。